最新のリリースでは、このページがまだ翻訳されていません。このページの最新版は英語でご覧になれます。

Triggered Subsystem

外部入力により実行がトリガーされるサブシステム

このページをすべて展開する

ライブラリ:
Simulink / Ports & Subsystems
HDL Coder / Ports & Subsystems

説明

Triggered Subsystem ブロックは、制御信号がトリガー値をもつたびに実行されるサブシステムを作成する開始点として事前設定された Subsystem ブロックです。

Trigger Subsystem ブロックを使用して以下をモデル化します。

トリガー値を検知したときに実行されるタスク。
I/O ハードウェアからの割り込み。
例外またはエラーを処理するプロセッサリクエスト。

端子

入力

すべて展開する

`In` — サブシステムブロックへの信号入力
スカラー | ベクトル | 行列

Inport ブロックをサブシステムブロック内に配置することで、ブロックへの外部入力端子が追加されます。端子ラベルは Inport ブロックの名前と一致します。

ローカル環境から信号を取得するには、Inport ブロックを使用します。

`Trigger` — サブシステムブロックへの信号入力の制御
スカラー

Trigger ブロックをサブシステムブロック内に配置することで、ブロックへの外部入力端子が追加されます。

出力

すべて展開する

`Out` — サブシステムからの信号出力
スカラー | ベクトル | 行列

Outport ブロックをサブシステムブロック内に配置することで、ブロックの出力端子が追加されます。サブシステムブロック上の端子ラベルは Outport ブロックの名前です。

信号をローカル環境に送信するには、Outport ブロックを使用します。

モデルの例

Triggered Subsystem

このモデルは Triggered Subsystem を示し、さまざまなトリガータイプを記述します。Triggered Subsystem は、トリガー端子が指定された方向で偽から真に遷移したときに必ず、単一のタイムステップで実行されます。このようなトリガー端子の遷移は、遷移の方向が立ち上がり、立ち下がりまたはその両方である場合に生じます。立ち上がり遷移は、トリガー信号遷移がゼロ以下から正の値に遷移するときに発生します。立ち下がり遷移は、トリガー信号遷移がゼロ以上から負の値に遷移するときに発生します。

モデルを開く

ブロックの優先順位

このモデルでは、ブロックに異なる優先度が割り当てられるとどのようになるのかを示します。ブロックの優先順位は、ブロックが実行される順序に影響を与えます。ブロックの優先順位は、[ブロックプロパティ] ダイアログで設定できます。

モデルを開く

ブロックの優先順位

モデルを開く

時相論理を使ったバンバン制御

この例では、Stateflow® を使用してボイラーのバンバン温度制御システムをモデル化する方法を示します。ボイラーのダイナミクスが Simulink® でモデル化されます。

モデルを開く

Triggered Subsystem を使ったエンジンタイミングのモデル化

この例では、4 シリンダー火花点火内燃エンジンのスロットルからクランクシャフト出力までをモデル化する方法を示します。不必要に複雑にすることなく、必要に応じて、システムの動的挙動を記述する経験的関係で補足される、明確に定義された物理的原理を使用しました。

モデルを開く

閉ループ制御を使ったエンジンタイミングモデル

この例では、開ループエンジンモデル (「Triggered Subsystem を使ったエンジンタイミングのモデル化」例で説明されている sldemo_engine) のバージョンを拡張する方法を示します。このモデル sldemo_enginewc は閉ループを含んでおり、Simulink® モデルの柔軟性と拡張性を示します。この拡張モデルでは、コントローラーの目的は、負荷トルクの変化の影響が最小限に抑えられるように、高速スロットルアクチュエータでエンジン速度を調節することです。これは、エンジンモデルに離散時間 PI コントローラーを追加することによって、Simulink で簡単に実装できます。

モデルを開く

ブロックの特性

データ型	`Boolean^[a]` \| `bus^[a]` \| `double^[a]` \| `enumerated^[a]` \| `fixed point^[a]` \| `integer^[a]` \| `single^[a]` \| `string^[a]`
直接フィードスルー	`いいえ`
多次元信号	`限定的^[a]`
可変サイズの信号	`限定的^[a]`
ゼロクロッシング検出	`いいえ`
^[a] 実際のデータ型または機能のサポートは、ブロックの実装に依存します。

拡張機能

C/C++ コード生成
Simulink® Coder™ を使用して C および C++ コードを生成します。

実際のコード生成のサポートは、ブロックの実装に依存します。

HDL コード生成
HDL Coder™ を使用して FPGA 設計および ASIC 設計のための Verilog および VHDL のコードを生成します。

HDL コード生成の詳細については、Triggered Subsystem を参照してください。

固定小数点の変換
Fixed-Point Designer™ を使用して固定小数点システムの設計とシミュレーションを行います。

実際のデータ型のサポートは、ブロックの実装に依存します。

参考

ブロック

Enabled Subsystem | Enabled and Triggered Subsystem | Function-Call Subsystem | Subsystem | Trigger

Triggered Subsystem

説明

端子