HDL Coder

FPGA 設計および ASIC 設計用の Verilog コードと VHDL コードの生成

HDL Coder™ は、MATLAB® 関数、Simulink® モデル、Stateflow® チャートから、移植と論理合成が可能な Verilog® コードと VHDL® コードを生成します。生成された HDL コードは FPGA プログラミングまたは ASIC プロトタイピングと設計に使用できます。

HDL Coder には、Xilinx® FPGA、 Microsemi® FPGA、および Intel® FPGA のプログラミングを自動化するワークフロー アドバイザーが用意されています。HDL のアーキテクチャと実装をコントロールし、クリティカル パスをハイライト表示し、ハードウェア リソースの使用率を表示することができます。HDL Coder は、Simulink モデルと、生成されたVerilog コードおよび VHDL コードとの間のトレーサビリティを提供することで、DO-254 およびその他の規格に準拠した高信頼性アプリケーションのコード検証を可能にします。

FPGAにLTE無線通信システムを実装:MATLABとSimulinkの全ワークフロー


機能

HDL コードの生成

可読性が良く、トレース可能、合成可能な VHDL または Verilog HDL を生成します。

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HDL コード生成の設計

固定小数点データ ストリーミングを実装するハードウェア用にアルゴリズムを適応させます。

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HDL コードの最適化

実装目標のバランスが取れるよう、アーキテクチャの探索を行います。.

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FPGA プロトタイピング

一般的な FPGA プロトタイプのボードおよびシステムへ簡単に実装できます。.

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量産用 FPGA、SoC、または ASIC への展開

VHDL および Verilog のテスト ベンチを生成し、生成された HDL コードの検証を高速化します。

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HDL コードの検証

MATLAB および Simulink テスト環境を再利用して、HDLシミュレータまたは FPGA 開発キット上で検証を行います。

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HDL コード生成のモデルベース デザインへの取り込み

HDL コード生成とモデルベース デザインを組み合わせることにより、設計チームの共同作業とTATを向上させることができます。

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製品リソース

これらのリソースを調べて HDL Coder をさらに詳しく知る。

ドキュメンテーション

リリース ノートやコード サンプルなど、HDL Coderの関数と機能のドキュメンテーションを調べる。

関数

使用できる HDL Coder 関数のリストを参照する。

動作環境

最新リリースの HDL Coder のシステム必要条件を見る。

技術情報

HDL Coder を使用する技術的な利点について説明する記事を読む。

ユーザー事例

HDL Coder の各業界の研究開発分野における活用事例を読む。

コミュニティとサポート

質問の答えを検索し、トラブルシューティング リソースを調べる。

ハードウェア サポート

HDL Coder をハードウェア プラットフォームに接続する。

関連ビデオ

HDL Coder アプリでは、対話型のインターフェイスを介して一般的なタスクにすばやくアクセス可能。

アプリ

HDL Coder アプリでは、対話型のインターフェイスを介して一般的なタスクにすばやくアクセス可能。


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