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速度の最適化

R2026a

クリティカルパスの推定および削減、パイプラインレジスタの挿入、ループ展開、クロック周波数の自動反復最適化

クリティカルパスを減らすことで、ターゲットの FPGA または SoC デバイスに合わせて設計のタイミングを改善し、クロック速度を増やします。さまざまなパイプライン手法を使用してクリティカルパスを減らすことができます。速度の最適化の概要については、HDL Coder での速度および面積の最適化を参照してください。

関数

`hdlcoder.optimizeDesign`	Automatic iterative HDL design optimization
`hdlcoder.supportedDevices`	Show supported target hardware and device details

クラス

hdlcoder.OptimizationConfig hdlcoder.optimizeDesign configuration object

ブロック

すべて展開する

HDL Operations

	Deserializer1D	スカラーストリームまたは小さいベクトルからベクトル信号への変換
	Multiply-Accumulate	入力に対して Multiply-Accumulate 演算を実行する
	Multiply-Add	乗算と加算の組み合わせ演算
	Serializer1D	ベクトル信号をスカラーまたは小さいベクトルに変換

トピック

適応パイプライン設定の指定
ターゲットデバイス、ターゲット周波数、乗算器の語長に基づくパイプラインの自動挿入。
クロックレートパイプライン
パイプラインレジスタを低速のデータレートではなく、高速のクロックレートで挿入する。
分散型パイプラインの設定の指定
分散型パイプラインの設定、利点、およびコスト。
Distributed Pipelining Using Synthesis Timing Estimates
Use synthesis timing estimates for distributed pipelining to more accurately reflect how components function on hardware to better distribute pipelines and increase clock frequency for your target device.
制約付き出力パイプライン
制約付き出力パイプラインの定義と使用例
自動反復最適化
自動反復最適化の仕組み、前提条件、制約事項。
合成実行なしのクリティカルパスの推定
サードパーティ製の合成ツールを使用しないで、設計内での推定クリティカルパスを検出します。
Generate Custom Timing Database for Custom Tools and Devices
Create a custom timing generator to characterize custom devices for your custom tools.
適応パイプラインが必要な設計パターン
特定の設計パターンでは、タイミング要件を満たすために適応パイプライン最適化を有効にしなければなりません。
Use Distributed Pipelining Optimization in Models with MATLAB Function Blocks
How to optimize HDL code for MATLAB Function blocks for speed by distributing design delays and generated pipeline stages.
MATLAB Datapath アーキテクチャを使用した、MATLAB Function ブロック境界を越えた HDL 最適化
MATLAB Function ブロック内、および MATLAB Function ブロックを越えたその他の Simulink^® ブロックとの間で最適化を適用する。