ハードウェアターゲティングの基礎

FPGA プラットフォームと SoC プラットフォームのターゲティングの基礎を学習

HDL Coder™ を使用してハードウェアをターゲットにする場合、目的に応じて異なる 2 つの開始点をもつ 1 つのワークフローに従うことができます。

市販されている既存のハードウェアプラットフォームのプロトタイプを迅速に作成するには、既存のボードおよびリファレンス設計を使用して FPGA の HDL アルゴリズムのプロトタイプを作成、展開し、ハードウェアソフトウェア協調設計ワークフローを開始します。
カスタムデバイスをターゲットとする量産ワークフローには、カスタムハードウェアプラットフォームを作成します。その後、ハードウェアソフトウェア協調設計ワークフローに従います。

詳細については、Targeting FPGA & SoC Hardware OverviewおよびSoC プラットフォーム向けのハードウェアソフトウェア協調設計ワークフローを参照してください。

クラス

hdlcoder.WorkflowConfig Configure HDL code generation and deployment workflows

トピック

Targeting FPGA & SoC Hardware Overview
High-level steps for targeting an FPGA or SoC platform.
SoC プラットフォーム向けのハードウェアソフトウェア協調設計ワークフロー
SoC プラットフォームをターゲットにする場合のワークフローステップの概要。
HDL ワークフローアドバイザーのご利用の前に
HDL ワークフローアドバイザーの基礎とさまざまなタスクの実行方法について学習します。
スクリプトを使用した HDL ワークフローの実行
HDL ワークフロー CLI コマンドスクリプトをエクスポート、インポートまたは構成する
HDL ワークフローアドバイザーのワークフロー
HDL ワークフローアドバイザーと選択できるさまざまなワークフロー、ターゲットにするプラットフォームについて確認する。
HDL ワークフローコマンドラインインターフェイス入門
この例では、HDL ワークフローアドバイザーを使用して、コマンドラインと [スクリプトへのエクスポート] 機能から HDL ワークフローを実行する方法を示します。
Generate IP Core from MATLAB for Blinking LED on FPGA Board
This example shows how to use the MATLAB® HDL Workflow Advisor to generate a custom HDL IP core that blinks LEDs on an FPGA board. You can use the generated IP on the Xilinx® Zynq® platform or on any Xilinx FPGA with the MicroBlaze processor.

注目の例

Getting Started with Targeting Xilinx Zynq Platform

Use the hardware-software co-design workflow to blink LEDs at various frequencies on the Xilinx® Zynq® ZC702 evaluation kit.

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Getting Started with Targeting Zynq UltraScale+ MPSoC Platform

Use the hardware-software co-design workflow to blink LEDs at various frequencies on the Xilinx® Zynq® UltraScale+ MPSoC.

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Getting Started with Targeting Intel SoC Devices

Use the hardware-software co-design workflow to blink LEDs at various frequencies on the Arrow® SoCKit® evaluation kit.

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Getting Started with Targeting Intel Quartus Pro Based Devices

Define and register the board and reference design for the Intel® Arria10 SoC development kit and use the hardware-software co-design workflow to blink LEDs at various frequencies on the Intel Arria 10 SoC development kit.

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Access DUT Registers on Xilinx Pure FPGA Board Using IP Core Generation Workflow

Use the HDL Coder™ IP core generation workflow to develop reference designs for Xilinx® parts that do not use an embedded ARM® processor present but that still utilize the HDL Coder generated AXI interface to control the design under test (DUT). This example uses the HDL Verifier™ AXI Manager IP to access the HDL Coder generated DUT registers by enabling the reference design parameter option Insert JTAG AXI Manager. You can then access DUT registers from MATLAB® directly. Alternatively, you can use the Xilinx JTAG AXI Master to access the DUT registers using Vivado® Tcl console by writing Tcl commands. For the Xilinx JTAG AXI Master, you must create a custom reference design. The FPGA design is implemented on the Xilinx Kintex®-7 KC705 board.

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Access DUT Registers on Intel Pure FPGA Board Using IP Core Generation Workflow

Use the HDL Coder™ IP core generation workflow to develop reference designs for Intel® parts that do not use an embedded ARM® processor present but that still utilize the HDL Coder generated AXI interface to control the design under test (DUT). This example uses the HDL Verifier™ AXI Manager IP to access the HDL Coder generated DUT registers by enabling the reference design parameter option Insert JTAG AXI Manager. You can then access DUT registers from MATLAB® directly. Alternatively, you can use the Intel Qsys JTAG to Avalon® Master Bridge IP to access the FPGA registers using Tcl commands in the Qsys system console. For the Intel JTAG AXI Master, you must create a custom reference design. The FPGA design is implemented on the Arrow® DECA MAX® 10 FPGA evaluation kit.

Integrate HDL IP Core with Microchip PolarFire SoC Icicle Kit Reference Design

Use the hardware-software co-design workflow to blink LEDs at various frequencies on the Microchip® PolarFire SoC Icicle kit.

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Author a Xilinx Zynq Linux Image for a Custom Zynq Board by Using MathWorks Buildroot

This example shows how to create a Zynq Linux image for starting a Zynq custom board with the Linux operating system in a Zynq workflow by using MathWorks buildroot system.

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クラス

トピック

注目の例

Getting Started with Targeting Xilinx Zynq Platform

Getting Started with Targeting Zynq UltraScale+ MPSoC Platform

Getting Started with Targeting Intel SoC Devices

Getting Started with Targeting Intel Quartus Pro Based Devices

Access DUT Registers on Xilinx Pure FPGA Board Using IP Core Generation Workflow

Access DUT Registers on Intel Pure FPGA Board Using IP Core Generation Workflow

Integrate HDL IP Core with Microchip PolarFire SoC Icicle Kit Reference Design

Author a Xilinx Zynq Linux Image for a Custom Zynq Board by Using MathWorks Buildroot

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