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If Action Subsystem

If ブロックで実行が有効化されるサブシステム

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ライブラリ:
Simulink / Ports & Subsystems

説明

If Action Subsystem ブロックは、実行が If ブロックで制御されるサブシステムを作成するときの開始点として事前構成されている Subsystem ブロックです。If ブロックは論理式を評価し、その評価結果に応じてアクション信号を出力します。サブシステムの実行は、サブシステム内に配置された Action Port ブロックで制御されます。

Simulink^® は If Action Subsystem ブロックに設定された優先順位を無視します。代わりに、サブシステムの実行を開始する If ブロックに優先順位を設定します。

If Action Subsystem ブロックからの信号のマージ

この例では、If ブロックで制御される信号をマージする方法を説明します。If ブロックは一連のサブシステムから If Action Subsystem ブロックの実行を選択します。If ブロックが選択するサブシステムに関係なく、Merge ブロックを使用して単一の信号を作成できます。モデルを開くには、ex_if_block を参照してください。

If Action Subsystem ブロック内のすべてのブロックは駆動側の If ブロックと同じレートで実行されなければなりません。この要件は、各ブロックのサンプル時間パラメーターを継承 (-1) または If ブロックのサンプル時間と同じ値のいずれかに設定することで満たすことができます。

固定小数点データ型のサポート

If ブロックは、固定小数点データ型を直接的にはサポートしません。ただし、この制限を解決するために、Compare To Constant ブロックを使用することができます。

固定小数点データ型をもたない以下の浮動小数点モデルを検討してください。モデルを開くには、ex_if_block_floating_point を参照してください。

このモデルでは、If Action Subsystem ブロックは既定の構成を使用します。次の表にリストされているパラメーターを除いて、シミュレーション パラメーターは既定値に設定されます。

[コンフィギュレーション パラメーター] ペイン	パラメーター	設定
ソルバー	開始時間	0.0
	終了時間	1.0
	タイプ	Fixed-step
	ソルバー	discrete (no continuous states)
	固定ステップサイズ	0.1

ブロック パラメーターは、次の表にリストされているパラメーターを除いて、既定値に設定されます。

ブロック	パラメーター	設定
Repeating Sequence Stair	出力値のベクトル	[-2 -1 1 2].'
Repeating Sequence Stair1	出力値のベクトル	[0 0 0 0 1 1 1 1].'
If	入力数	2
	If 式	(u1 > 0) | (u2 > 0.5)
	else 条件の表示	オン
Constant	定数値	-4
Constant1	定数値	4
Scope	座標軸数	3
	時間範囲	1

このモデルの場合、入力 u1 が 0 より大きいか、入力 u2 が 0.5 より大きいときに、出力は 4 になります。そうでない場合、出力は -4 です。Scope ブロックは、入力 u1 と u2 を使用して Merge ブロックからの出力を表示します。

次のブロック線図を固定小数点データ型のモデルとして実装できます。モデルを開くには、ex_if_block_fixed_point を参照してください。

Repeating Sequence Stair ブロックは固定小数点データ型を出力します。

Compare To Constant ブロックは、[If 式] の 2 つの部分を実現します。これらは、モデルの浮動小数点バージョンの If ブロックで使用される (u1 > 0) と (u2 > 0.5) です。OR 演算、(u1|u2) は、If ブロック内で実現されています。固定小数点モデルに対して、式はこのモデルに示すように If ブロックの外側で部分的に実現されなければなりません。

固定小数点モデルのブロックとシミュレーション パラメーターは、浮動小数点モデルと同様ですが、次の追加点があります。

ブロック	パラメーター	設定
Compare To Constant	演算子	>
	定数値	0
	出力データ型モード	Boolean
	ゼロクロッシング検出を有効にする	off
Compare To Constant1	演算子	>
	定数値	0.5
	出力データ型モード	Boolean
	ゼロクロッシング検出を有効にする	off
If	入力数	2
	If 式	u1|u2

例

Simulink Subsystem のセマンティクス

この一連の例では、さまざまなタイプの Simulink® Subsystem と、これらの Subsystem のシミュレーション実行時にどのようなセマンティクスが使用されるかという例を示します。各例では、モデルと、そのモデルの実行方法に関する違いを説明しています。

モデルを開く

If-Then-Else ブロック

この例では、正弦波をIf Action Subsystemブロックに入力した場合の影響を示します。これは、If Action Subsystem ブロックとEnabled Subsystemブロックの類似度を示すよう設計されています。

モデルを開く

If ブロックを使ったクラッチ ロックアップのモデル化

この例では、If/Else サブシステムを使用してクラッチ モデルを作成する方法を示します。If サブシステムがクラッチ ダイナミクスをロック位置でモデル化するのに対して、Else サブシステムはロック解除位置でモデル化します。If ブロックを使用していずれかを有効にします。If ブロックからの一点鎖線は、制御信号を示しています。この信号は、If/Else (または他の条件付き) サブシステムを有効にするために使用されます。GUI 上のボックスのいずれかをチェックすると、(時間に対して) 選択された変数のいずれかのプロットが生成されます。

モデルを開く

端子

入力

In — サブシステム ブロックへの信号入力

スカラー | ベクトル | 行列

Inport ブロックをサブシステム ブロック内に配置することで、ブロックへの外部入力端子が追加されます。端子ラベルは Inport ブロックの名前と一致します。

ローカル環境から信号を取得するには、Inport ブロックを使用します。

データ型: half | single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | Boolean | fixed point | enumerated | bus

Action — サブシステム ブロックへの信号入力の制御

スカラー | ベクトル | 行列

Action Port ブロックをサブシステム ブロック内に配置することで、ブロックに外部入力端子が追加され、ブロックが If Action Subsystem に変更されます。

Switch Case ブロックから Switch Case Action Subsystem ブロックへの一点鎖線は "アクション" 信号を表します。アクション信号は、Switch Case Action Subsystem ブロックのアクション端子に接続されている制御信号です。アクション信号のメッセージによってサブシステムの実行が開始されます。

データ型: action

出力

Out — サブシステムからの信号出力

スカラー | ベクトル | 行列

Outport ブロックをサブシステム ブロック内に配置することで、ブロックの出力端子が追加されます。サブシステム ブロック上の端子ラベルは Outport ブロックの名前です。

信号をローカル環境に送信するには、Outport ブロックを使用します。

データ型: half | single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | Boolean | fixed point | enumerated | bus

ブロックの特性

データ型	Booleana | busa | doublea | enumerateda | fixed pointa | halfa | integera | singlea | stringa
直達	いいえ
多次元信号	はいa
可変サイズの信号	はいa
ゼロクロッシング検出	いいえ
a 実際のデータ型または機能のサポートは、ブロックの実装に依存します。

拡張機能

C/C++ コード生成

Simulink® Coder™ を使用して C および C++ コードを生成します。

実際のコード生成のサポートは、ブロックの実装に依存します。

HDL コード生成

HDL Coder™ を使用して FPGA 設計および ASIC 設計のための Verilog および VHDL のコードを生成します。

HDL Coder™ には、HDL の実装および合成されたロジックに影響する追加のコンフィギュレーション オプションがあります。

HDL アーキテクチャ

アーキテクチャ	説明
Module (既定値)	サブシステムとそのサブシステム内のブロックのコードを生成します。
BlackBox	ブラック ボックス インターフェイスを生成します。生成された HDL コードには、サブシステムの入力/出力端子定義のみ含まれます。したがって、モデル内のサブシステムを使用して、手動作成された既存の HDL コードへのインターフェイスを生成できます。 サブシステムのブラックボックス インターフェイスの生成は、クロック信号を使用しない Model ブロック インターフェイスの生成と似ています。
No HDL	生成されたコードからサブシステムを削除します。シミュレーションでサブシステムを使用できますが、HDL コード内では "ノーオペレーション" として扱います。

HDL ブロック プロパティ

一般
AdaptivePipelining	合成ツール、ターゲット周波数、乗算器の語長に基づくパイプラインの自動挿入。既定の設定は [inherit] です。AdaptivePipelining (HDL Coder)も参照してください。
BalanceDelays	あるパスに新しい遅延が導入されたことを検出し、それに一致する遅延を他のパスに挿入します。既定の設定は [inherit] です。BalanceDelays (HDL Coder)も参照してください。
ClockRatePipelining	パイプライン レジスタを低速のデータ レートではなく高速のクロック レートで挿入します。既定の設定は [inherit] です。ClockRatePipelining (HDL Coder)も参照してください。
ConstrainedOutputPipeline	既存の遅延を設計内で移動することによって出力に配置するレジスタの数。分散型パイプラインではこれらのレジスタは再分散されません。既定の設定は 0 です。詳細については、ConstrainedOutputPipeline (HDL Coder)を参照してください。
DistributedPipelining	パイプライン レジスタの分散、またはレジスタのリタイミング。既定の設定は [inherit] です。DistributedPipelining (HDL Coder)も参照してください。
DSPStyle	乗算器のマッピングの合成属性。既定の設定は [なし] です。DSPStyle (HDL Coder)も参照してください。
FlattenHierarchy	生成された HDL コードからサブシステム階層を削除します。既定の設定は [inherit] です。FlattenHierarchy (HDL Coder)も参照してください。
InputPipeline	生成されたコードに挿入する入力パイプライン ステージ数。分散型パイプラインと制約付き出力パイプラインでは、これらのレジスタを移動できます。既定の設定は 0 です。詳細については、InputPipeline (HDL Coder)を参照してください。
OutputPipeline	生成されたコードに挿入する出力パイプライン ステージ数。分散型パイプラインと制約付き出力パイプラインでは、これらのレジスタを移動できます。既定の設定は 0 です。詳細については、OutputPipeline (HDL Coder)を参照してください。
SharingFactor	単一の共有リソースにマッピングされる、機能的に等価なリソースの数。既定の設定は 0 です。リソース共有 (HDL Coder)も参照してください。
StreamingFactor	時間多重化されてシリアルのスカラー データ パスに変換される、パラレル データ パスの数、またはベクトルの数。既定値は 0 であり、パラレル データ パスがそのまま実装されます。ストリーミング (HDL Coder)も参照してください。

ターゲット仕様

このブロックは DUT にできないため、[ターゲット仕様] タブのブロック プロパティ設定は無視されます。

制限

サブシステムの出力がバスの場合、出力端子の [初期条件] は 0 にする必要があります。

固定小数点の変換

Fixed-Point Designer™ を使用して固定小数点システムの設計とシミュレーションを行います。

実際のデータ型のサポートは、ブロックの実装に依存します。

バージョン履歴

R2006a より前に導入

参考

Action Port | If | Subsystem

トピック

• 選択サブシステムの実行