速度と面積の最適化

リソースの共有、ストリーミング、パイプライン、RAM マッピングによる改善

関数

`coder.hdl.loopspec`	Unroll or stream loops in generated HDL and SystemC code
`coder.hdl.pipeline`	Insert pipeline registers at output of MATLAB expression

トピック

最適化の基礎

HDL Coder での速度および面積の最適化
さまざまな速度および面積の最適化と、設計の最適化方法を確認。
クロックイネーブルの速度の指定
クロックイネーブルを設計のベース速度または入力データ速度で実行するように設定します。
クロックイネーブルの最小化
クロックイネーブルのないレジスタのコードを生成する
定数乗算器の最適化
定数乗算器の最適化とは何か、およびこの最適化を指定する方法

面積の最適化

永続配列と dsp.Delay の RAM へのマッピング
HDL ワークフローアドバイザーで [MATLAB から HDL へのワークフロー]、[コード生成]、[最適化] タブを選択します。
ROM への行列のマッピング
行列定数を ROM にマッピングするには、次の条件があります。
MATLAB コードの RAM マッピング
RAM マッピングとは、MATLAB^® コードのストレージと遅延の要素を RAM にマッピングする面積の最適化です。
MATLAB コードの RAM マッピングの比較
hdl.RAM、dsp.Delay、永続配列変数およびユーザー定義 System object™ のプライベートプロパティは RAM にマップできますが、異なる属性をもちます。

速度の最適化

MATLAB コードのパイプライン化
パイプラインは、レジスタをハードウェアの戦略的な場所に挿入してクリティカルパスを分割することで、最大クロック速度の向上に役立ちます。
MATLAB 式のパイプライン
MATLAB 式の出力へのレジスタの挿入
MATLAB ループの最適化
面積または速度のためのループの最適化
分散型パイプライン方式
分散型パイプライン方式の定義、利点およびコスト

注目の例

Distributed Pipelining for Clock Speed Optimization

Use the distributed pipelining and loop unrolling optimizations in HDL Coder to optimize clock speed.

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Map Matrices to Block RAMs to Reduce Area

Use the RAM mapping optimization in HDL Coder™ to map persistent matrix variables to block RAMs in hardware.

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Resource Sharing of Multipliers to Reduce Area

Use the resource sharing optimization in HDL Coder™. This optimization identifies functionally equivalent multiplier operations in MATLAB® code and shares them in order to optimize design area. You have control over the number of multipliers to be shared in the design.

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Loop Streaming to Reduce Area

Use the design-level loop streaming optimization in HDL Coder™ to optimize area.

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Constant Multiplier Optimization to Reduce Area

Perform a design-level area optimization in HDL Coder™ by converting constant multipliers into shifts and adds using canonical signed digit (CSD) techniques. The CSD representation of multiplier constants for example, in gain coefficients or filter coefficients) significantly reduces the area of the hardware implementation.

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