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Sequence Feedback

UVM テストベンチモデルでスコアボードとシーケンスを接続する

R2023a 以降

アドオンが必要: この機能には ASIC Testbench for HDL Verifier アドオンが必要です。

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ライブラリ:
HDL Verifier / For Use with DPI-C SystemVerilog

説明

Sequence Feedback ブロックは、スコアボードからのフィードバック信号を UVM テスト ベンチ モデルのシーケンスに促進します。このブロックは、Initial condition パラメータが 0 に設定された Unit Delay (Simulink) ブロックを実装します。

端子

入力

Port_1 — スコアボードサブシステムからのフィードバック信号

スカラー

Sequence Feedback ブロックは、scoreboard サブシステムからの入力信号を直接受け入れます。

データ型: single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | Boolean | fixed point

出力

Port_1 — シーケンスサブシステムへのフィードバック信号

スカラー

Sequence Feedback ブロックは、sequence サブシステムに直接信号を出力します。

データ型: single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | Boolean | fixed point

バージョン履歴

R2023a で導入

参考

トピック

• UVM コンポーネント生成の概要