Using MATLAB and FPGA-in-the-Loop to design a filter.

バージョン 1.0 (2.84 MB) 作成者: Pablo Trujillo Juan

Workflow to design, test, verify and implement a filter on FPGA.

https://www.controlpaths.com/2020/12/20/using-matlab-and-fpga-in-the-loop-part-1/

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更新 2020/12/20

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This project describes the entire workflow to design a filter and implement it on an FPGA.
- Study the filter requirements.
- Design the filter using Filter Designer tool.
- Test the filter, and the quantified filter on MATLAB and Simulink.
- Generate the HDL code of the filter.
- Verify the filter on the corresponding device using FPGA-in-the-Loop
- Integrate the filter on a Vivado design and test it on the application.

引用

Pablo Trujillo Juan (2024). Using MATLAB and FPGA-in-the-Loop to design a filter. (https://github.com/controlpaths/line_filtering/releases/tag/1.0), GitHub. 取得済み April 26、2024.

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1.0	2020/12/20		ダウンロード

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