Wrap To Zero
入力がしきい値よりも上の場合、出力をゼロに設定

ライブラリ:
Simulink /
Discontinuities
HDL Coder /
Discontinuities
説明
Wrap To Zero ブロックは、入力が [しきい値] の値より大きい場合、出力をゼロに設定します。入力が [しきい値] 以下の場合、出力は入力と等しくなります。
端子
入力
Port_1 — 入力信号
スカラー | ベクトル
入力信号。スカラーまたはベクトルとして指定します。Threshold
の値以上の信号の値はゼロに設定されます。
データ型: single
| double
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
| Boolean
| fixed point
出力
Port_1 — 出力信号
スカラー | ベクトル
出力信号。入力信号の値またはゼロに設定されます。出力のデータ型は、入力のデータ型と同じです。
ヒント
入力データ型がゼロを表現できない場合、パラメーター オーバーフローが発生します。このオーバーフローを検出するには、[コンフィギュレーション パラメーター] ダイアログ ボックスの [診断]、[データ有効性] ペインに移動して、[パラメーター]、[オーバーフローの検出] を [警告]
または [エラー]
に設定します。
データ型: single
| double
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
| Boolean
| fixed point
パラメーター
Wrap to Zero ブロックのパラメーターを編集するには、ブロック アイコンをダブルクリックします。
しきい値 — ゼロを出力するときのしきい値
255
(既定値) | スカラー
出力値をゼロに設定するときのしきい値です。
プログラムでの使用
ブロック パラメーター: Threshold |
型: 文字ベクトル |
値: scalar |
既定の設定: '255' |
ブロックの特性
データ型 |
|
直達 |
|
多次元信号 |
|
可変サイズの信号 |
|
ゼロクロッシング検出 |
|
拡張機能
C/C++ コード生成
Simulink® Coder™ を使用して C および C++ コードを生成します。
HDL コード生成
HDL Coder™ を使用して FPGA 設計および ASIC 設計のための Verilog および VHDL のコードを生成します。
HDL Coder™ には、HDL の実装および合成されたロジックに影響する追加のコンフィギュレーション オプションがあります。
このブロックには 1 つの既定の HDL アーキテクチャがあります。
ConstrainedOutputPipeline | 既存の遅延を設計内で移動することによって出力に配置するレジスタの数。分散型パイプラインではこれらのレジスタは再分散されません。既定の設定は |
InputPipeline | 生成されたコードに挿入する入力パイプライン ステージ数。分散型パイプラインと制約付き出力パイプラインでは、これらのレジスタを移動できます。既定の設定は |
OutputPipeline | 生成されたコードに挿入する出力パイプライン ステージ数。分散型パイプラインと制約付き出力パイプラインでは、これらのレジスタを移動できます。既定の設定は |
入力信号と [しきい値] パラメーターは同じサイズでなければなりません。たとえば、入力が 2 次元のベクトルである場合、[しきい値] も 2 次元のベクトルでなければなりません。
PLC コード生成
Simulink® PLC Coder™ を使用して構造化テキスト コードを生成します。
固定小数点の変換
Fixed-Point Designer™ を使用して固定小数点システムの設計とシミュレーションを行います。
バージョン履歴
R2006a より前に導入
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