HDL Coder

FPGA 設計および ASIC 設計用の Verilog コードと VHDL コードの生成

HDL Coder™ は、MATLAB® 関数、Simulink® モデル、Stateflow® チャートから、移植と論理合成が可能な Verilog® コードと VHDL® コードを生成します。生成された HDL コードは FPGA プログラミングまたは ASIC プロトタイピングと設計に使用できます。

HDL Coder には、Xilinx® FPGA および Intel® FPGA のプログラミングを自動化するワークフロー アドバイザーが用意されています。HDL のアーキテクチャと実装をコントロールし、クリティカル パスをハイライト表示し、ハードウェア リソースの使用率を表示することができます。HDL Coder は、Simulink モデルと、生成されたVerilog コードおよび VHDL コードとの間のトレーサビリティを提供することで、DO-254 およびその他の規格に準拠した高信頼性アプリケーションのコード検証を可能にします。


機能

HDL コードの生成

FPGA および ASIC を実装するための合成可能な HDL コードを生成します。

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HDL コードの最適化

分散パイプライン、ストリーミングおよびリソース共有を採用することで、HDL コードを最適化し、速度-面積に関する目標を達成します。

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FPGA 設計の自動化

MATLAB アルゴリズムと Simulink モデルを Xilinx および Altera FPGA に実装するワークフローを自動化します。

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HDL コードの検証

VHDL および Verilog のテスト ベンチを生成し、生成された HDL コードの検証を高速化します。

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HDL コードのドキュメント化および追跡

生成されたコードを HTML レポートにドキュメント化します。このレポートには、ハイパーリンクが設定された HDL コードおよび生成された HDL ファイルの表が含まれています。

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HDL コーディング標準

RMM および STARC などの一般的な産業コーディング ガイドラインを満たす VHDL コードおよび Verilog コードを生成します。

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製品リソース

これらのリソースを調べて HDL Coder をさらに詳しく知る。

ドキュメンテーション

リリース ノートやコード サンプルなど、HDL Coderの関数と機能のドキュメンテーションを調べる。

関数

使用できる HDL Coder 関数のリストを参照する。

動作環境

最新リリースの HDL Coder のシステム必要条件を見る。

技術情報

HDL Coder を使用する技術的な利点について説明する記事を読む。

ユーザー事例

HDL Coder の各業界の研究開発分野における活用事例を読む。

コミュニティとサポート

質問の答えを検索し、トラブルシューティング リソースを調べる。

ハードウェア サポート

HDL Coder をハードウェア プラットフォームに接続する。

関連ビデオ

HDL Coder アプリでは、対話型のインターフェイスを介して一般的なタスクにすばやくアクセス可能。

アプリ

HDL Coder アプリでは、対話型のインターフェイスを介して一般的なタスクにすばやくアクセス可能。


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HDL Coder requires MATLAB, Fixed-Point Designer, and MATLAB Coder.


 関連ソリューション

HDL Coder を使用して、科学および工学分野の課題を解決します。


ニュース&イベント

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HDL Implementation and Verification of a High-Performance FFT