MISRA C:2012 Rule 13.2
The value of an expression and its persistent side effects shall be the same under all permitted evaluation orders and shall be independent from thread interleaving
説明
ルール定義
The value of an expression and its persistent side effects shall be the same under all permitted evaluation orders and shall be independent from thread interleaving 1 .
根拠
評価の順序に応じて式の結果が異なる値になる場合、その値は処理系定義になります。
スレッド インターリーブの順序に応じて式の結果が異なる値になる場合、C 標準ではスレッド インターリーブの順序を指定していないため、その値は予測不可能になります。このような予測できない動作は、コードに、未定義の動作であるデータ レース状態が含まれる可能性があることを示唆します。
Polyspace 実装
ルール チェッカーは式が以下の条件を 1 つでも満たす場合、違反を報告します。
同じ変数が式内で複数回変更される、あるいは同じ変数に対して読み取りと書き込みの両方が実行される。
式が複数の評価順序を許可している。
式内で単一の
volatileオブジェクトが複数回出現する。式に複数の
volatileオブジェクトが含まれる。
volatile オブジェクトは随時、その値を変更可能であるため、複数の volatile 変数または同じ volatile 変数の複数のインスタンスが含まれる式は、評価順序によって結果が異なる可能性があります。
トラブルシューティング
ルール違反を想定していてもその違反が表示されない場合、コーディング規約違反が想定どおりに表示されない理由の診断を参照します。
例
チェック情報
| グループ: 二次的影響 |
| カテゴリ: 必要 |
| AGC カテゴリ: 必要 |
バージョン履歴
R2014b で導入参考
MISRA C:2012 Dir 4.9 | MISRA C:2012 Rule 13.1 | MISRA C:2012 Rule 13.3 | MISRA C:2012 Rule 13.4 | MISRA C:2012 のチェック (-misra3)
1 All MISRA coding rules and directives are © Copyright The MISRA Consortium Limited 2021.
The MISRA coding standards referenced in the Polyspace Bug Finder™ documentation are from the following MISRA standards:
MISRA C:2004
MISRA C:2012
MISRA C:2023
MISRA C++:2008
MISRA C++:2023
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