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ufi

(非推奨) 符号なし固定小数点数値オブジェクトの作成

ufi は推奨されません。代わりに fi を使用してください。

構文

a = ufi
a = ufi(v)
a = ufi(v,w)
a = ufi(v,w,f)
a = ufi(v,w,slope,bias)
a = ufi(v,w,slopeadjustmentfactor,fixedexponent,bias)

説明

コンストラクター関数 ufi は次のように使用することができます。

  • a = ufi は既定のコンストラクターで、値をもたない、語長が 16 ビット、小数部の長さが 15 ビットの符号なし fi オブジェクトを返します。

  • a = ufi(v) は、値が v、語長が 16 ビット、小数部の長さが最高精度の符号なし固定小数点オブジェクトを返します。

  • a = ufi(v,w) は、値が v、語長が w、小数部の長さが最高精度の符号なし固定小数点オブジェクトを返します。

  • a = ufi(v,w,f) は、値が v、語長が w、小数部の長さが f の符号なし固定小数点オブジェクトを返します。

  • a = ufi(v,w,slope,bias) は、値が v、語長が wslope、および bias の符号なし固定小数点オブジェクトを返します。

  • a = ufi(v,w,slopeadjustmentfactor,fixedexponent,bias) は、値が v、語長が wslopeadjustmentfactorfixedexponent、および bias の符号なし固定小数点オブジェクトを返します。

コンストラクター関数 ufi で作成された fi オブジェクトは、次の一般的なプロパティ タイプをもっています。

メモ

コンストラクター関数 ufi で作成された fi オブジェクトにはローカル fimath がありません。

すべて折りたたむ

たとえば、次の例では値 pi、語長 8 ビット、小数部の長さ 3 ビットの符号なし fi オブジェクトを作成します。

a = ufi(pi,8,3)
a =
 
    3.1250

          DataTypeMode: Fixed-point: binary point scaling
            Signedness: Unsigned
            WordLength: 8
        FractionLength: 3

既定の fimath プロパティが a に関連付けられています。fi オブジェクトにローカル fimath オブジェクトが存在しない場合、出力には fimath オブジェクトのプロパティが表示されません。fi オブジェクトに fimath オブジェクトがあるかどうかを判断するには、関数 isfimathlocal を使用します。

isfimathlocal(a)
ans =
     0

返された値が 0 の場合、fi オブジェクトにはローカル fimath オブジェクトが存在しないことを意味します。関数 isfimathlocal1 を返す場合、fi オブジェクトはローカル fimath オブジェクトをもちます。

v は配列も可能です。

a = ufi((magic(3)/10),16,12)
a =
 
    0.8000    0.1001    0.6001
    0.3000    0.5000    0.7000
    0.3999    0.8999    0.2000

          DataTypeMode: Fixed-point: binary point scaling
            Signedness: Unsigned
            WordLength: 16
        FractionLength: 12

引数 f を省略すると、可能な最高精度に自動的に設定されます。

a = ufi(pi,8)
a =
 
    3.1406

          DataTypeMode: Fixed-point: binary point scaling
            Signedness: Unsigned
            WordLength: 8
        FractionLength: 6

wf を省略すると、それぞれ 16 ビットと可能な最高精度に自動的に設定されます。

a = ufi(pi)
a =
 
    3.1416

          DataTypeMode: Fixed-point: binary point scaling
            Signedness: Unsigned
            WordLength: 16
        FractionLength: 14

拡張機能

HDL コード生成
HDL Coder™ を使用して FPGA 設計および ASIC 設計のための VHDL、Verilog および SystemVerilog のコードを生成します。

バージョン履歴

R2009b で導入